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首页 > FAIRCHILD 飞兆半导体 > 模拟和混合信号 > FIN224AC

FIN224AC: 22位串并/并串转换器(*推荐新设计使用)

FIN224AC µSerDes™ 是一款低功耗串并/并串转换器(SerDes),有助于最大限度地降低传输宽信号路径时的成本和功耗。 通过使用串行化,可以有效减少从一个点到另一个点传输的信号数量。 单向路径的减少比率通常为4:1至6:1。 对于双向操作,可以对多个信号源使用半双工,从而实现接近10:1的减少比率。 通过差分信号还可以最大限度地减少屏蔽和EMI滤波器,进一步降低串行化的成本。 差分信号对于提供一个能承受无线电和电气噪声源的噪声不敏感信号来说也非常重要。 功耗的大幅减少最大限度地减少了对超便携应用中电池寿命的影响。 对于大部分应用,包括双向操作,可以使用单个PLL。

数据手册DataSheet
FIN224AC.pdf
特性
  • 业界最小的 22 位串并/并串转换器对
  • 低功耗,最大限度地减少对电池寿命的影响
  • 多掉电模式
  • 待机模式下100nA,典型工作条件下 5mA
  • 高碾压 LVCMOS 边沿速率选项,满足法规要求
  • 电缆减少: 25:4或更高
  • 差分信号:
  • 在实验室条件下使用 CTL 时,90dBm EMI
  • 最大限度地减少屏蔽
  • 最大限度地减少 EMI 滤波器
  • 最大限度地降低对外部干扰的敏感度
  • 两个方向上最高均可达 22 位
  • 最高可达 26MHz 的并行接口操作
  • 电压从 1.65V 转换为 3.6V
  • 高 ESD 保护: > 15 kV HBM
  • 并行I/O电源(VDDP)范围:1.65V至3.6V
  • 支持微控制器或 RGB 像素接口
Ordering Code
产品产品和生态状况单价/1K包装方法规则丝印标记
FIN224ACMLX量产 绿色:截至2006年8月  中国 RoHS$1.95MLP 6x6 40L (Power 66)  -  0.8 x 6 x 6mm,  卷带
  • MLP 6x6 40L (Power 66)  示意图 最后更新: 2015年1月
  • MLP40-6.0x6.0-MSL3 Packing Drawing 最后更新: 2015年10月
  • MLP4MM Tape and Reel Packing Drawing 最后更新: 2016年8月
第一行$Y (飞兆徽标)
&Z (工厂编码)
&2 (2 位日期代码)
&K

第二行FIN224

第三行AC

Application Notes
  • AN-5053 Using Fairchild µSerDes™ Devices with a Synchronous Pixel Interface 最后更新 : 2011年3月03日
  • AN-5058 µSerDes™ Family Frequently Asked Questions (FAQ) 最后更新 : 2011年3月03日
  • AN-5061 µSerDes™ Layout Guidelines 最后更新 : 2011年3月03日
  • FIN224AC.pdf
    MLP 6x6 40L (Power 66)  Drawing Last Update: Jan 2015
    MLP40-6.0x6.0-MSL3 Packing Drawing Last Update: Oct 2015
    MLP4MM Tape and Reel Packing Drawing Last Update: Aug 2016
    µSerDes™ Family Frequently Asked Questions (FAQ) Last Update : 03-Mar-2011
    Using Fairchild µSerDes™ Devices with a Synchronous Pixel Interface Last Update : 03-Mar-2011
    µSerDes™ Layout Guidelines Last Update : 03-Mar-2011
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