74LVC1G02提供单路2输入或非功能。
输入可以从3.3 V或5 V器件驱动。这些特性允许在混合3.3 V和5 V环境中使用这些器件。
所有输入处的施密特触发器动作使电路容许较慢的输入上升和下降时间。
该器件完全适合使用IOFF的局部掉电应用。IOFF电路可禁用输出,防止掉电时破坏性回流电流通过该器件。
名称/描述 | Modified Date |
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Single 2-input NOR gate (REV 11.0) PDF (347.0 kB) 74LVC1G02 [English] | 29 Jun 2012 |
名称/描述 | Modified Date |
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Sorting through the low voltage logic maze (REV 1.0) PDF (72.0 kB) AN10156 [English] | 13 Mar 2013 |
Package lead inductance considerations in high-speed applications (REV 1.0) PDF (43.0 kB) AN212 [English] | 13 Mar 2013 |
Pin FMEA for LVC family (REV 1.0) PDF (44.0 kB) AN11009 [English] | 04 Feb 2011 |
MicroPak soldering information (REV 2.0) PDF (245.0 kB) AN10343 [English] | 30 Dec 2010 |
名称/描述 | Modified Date |
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XSON6: extremely thin small outline package; no leads; 6 terminals; body 1.0 x 1.0 x 0.35 mm (REV 1.0) PDF (192.0 kB) SOT1202 [English] | 08 Feb 2016 |
名称/描述 | Modified Date |
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Reversed product orientation 12NC ending 132 (REV 2.0) PDF (92.0 kB) SOT1202_132 [English] | 04 Apr 2013 |
名称/描述 | Modified Date |
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MAR_SOT1202 Topmark (REV 1.0) PDF (49.0 kB) MAR_SOT1202 [English] | 03 Jun 2013 |
型号 | 状态 | Family | 功能 | VCC (V) | Logic switching levels | 类型 | 说明 | Package version | Output drive capability (mA) | tpd (ns) | fmax (MHz) | No of bits | Power dissipation considerations | Tamb (Cel) | Rth(j-a) (K/W) | Ψth(j-top) (K/W) | Rth(j-c) (K/W) | Package name | No of pins |
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74LVC1G02GS | Active | LVC | NOR gates | 1.65 - 5.5 | CMOS/LVTTL | NOR gates | single 2-input NOR gate | SOT1202 | +/- 32 | 2.1 | 150 | 1 | low | -40~125 | 325 | 29.9 | 218 | XSON6 | 6 |
产品编号 | 封装说明 | Outline Version | 回流/波峰焊接 | 包装 | 产品状态 | 部件编号订购码 (12NC) | Marking | 化学成分 | RoHS / 无铅 / RHF | 无铅转换日期 | EFR | IFR(FIT) | MTBF(小时) | MSL | MSL LF |
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74LVC1G02GS | ![]() | SOT1202 | Reel 7" Q1/T1, Q3/T4 | Active | 74LVC1G02GS,132 (9352 928 93132) | VB | 74LVC1G02GS | ![]() ![]() ![]() | Always Pb-free | 123.8 | 3.87 | 2.58E8 | 1 | 1 |