LS173四位寄存器中有若干 D型触发器,它的特点是采用图腾柱三态输出,可以驱动大电容或低阻抗负载。高阻第三态和高电平驱动使这些触发器可以直接接系统总线、直接驱动总线,而不需要接口或升压元件。在一条公共总线上可以接多达 128个 74LS173输出,而这些输出仍旧可分别驱动两个 54LS/74LS系列TTL 标准负载。同样, 在一条公共总线上, 也可接多达 49个 74LS173输出, 而这些输出仍可分别驱动一个外加的 54LS/74LS TTL普通负载。为了尽量减小在相反电平下两个输出占用一根公共总线的可能性,输出控制线路设计成平均输出禁止时间短于平均输出使能时间。
LS173的门控使能输入是为控制数据进入触发器而设置的。当两个数据使能(、)输入都为低电平时,D输入的数据在下一个缓冲时钟输入正跳变时送入它们各自的触发器。LS173也设有门输出控制(M、N)的输入。当两者都为低电平时,四个输出的正常逻辑状态(高电平或低电平)可以驱动负载或总线。如果任何一个输出控制输入为高电平,则时钟电平可以单独禁止输出。于是输出呈现高阻状态,它既不给总线加负载也不驱动总线。
符号 | 参数名称 | 74LS173 | 54LS173 | 单位 | |||||
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最小 | 典型 | 最大 | 最小 | 典型 | 最大 | ||||
Vcc | 电源电压 | 4.75 | 5 | 5.25 | 4.5 | 5 | 5.5 | V | |
VIH | 输入高电平电压 | 2.0 | 2.0 | V | |||||
VIL | 输入低电平电压 | 0.8 | 0.7 | V | |||||
IOH | 输出高电平电流 | -2.6 | -1.0 | mA | |||||
IOL | 输出低电平电流 | 24 | 12 | mA | |||||
fCK | 时钟频率 | 0 | 30 | 0 | 30 | MHz | |||
tW | 时钟或清零脉冲宽度 | 20 | 20 | ns | |||||
数据使能 | 35 | 35 | ns | ||||||
tsu | 建立时间 | 数据 | 17 | 17 | |||||
清除无效态 | 10 | 10 | |||||||
th | 保持时间 | 数据使能 | 0 | 0 | ns | ||||
数据 | 3 | 3 | |||||||
TA | 工作环境温度 | -40 | 85 | -55 | 125 | ℃ |
电 性 能:(除特别说明外,均为全温度范围)
符号 | 参数名称 | 测试条件 | 74LS173 | 54LS173 | 单位 | |||||
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最小 | 典型 | 最大 | 最小 | 典型 | 最大 | |||||
VIK | 输入钳位电压 | Vcc=最小 II =-18mA | -1.5 | -1.5 | V | |||||
VOH | 输出高电平电压 | Vcc=最小 VIL=最大 VIH=2V IOH=最大 | 2.4 | 2.4 | 3.1 | V | ||||
VOL | 输出低电平电压 | Vcc=最小 VIL =最大 VIH=2V IOL =最大 | 0.5 | 0.25 | 0.4 | V | ||||
IOZH | 高关态输出电流 | Vcc=最大 VIL =最大 VIH=2.0V Vo=2.7V | 20 | 20 | μA | |||||
IOZL | 低关态输出电流 | Vcc=最大 VIL=最大 VIH=2.0V Vo=0.4V | -20 | -20 | μA | |||||
II | 输入电流 (最大输入电压时 ) | Vcc=最大 VI=7V | 0.1 | 0.1 | mA | |||||
IIH | 输入高电平电流 | Vcc=最大 VI=2.7V | 20 | 20 | μA | |||||
IIL | 输入低电平电流 | Vcc=最大 VI=0.4V | -0.4 | -0.4 | mA | |||||
IOS | 输出短路电流 | Vcc=最大 VO=0V | -30 | -130 | -30 | -130 | mA | |||
ICC | 电源电流 | Vcc=最大(注) | 24 | 19 | 30 | mA |
注:测 Icc时,所有输出开路,清零(CLR)输入瞬时接地后再接4.5V,输出控制 N、数据使能、和所有数据输入接地,时钟(CLK)输入和输出控制M接4.5V。 所有典型值均在 Vcc=5.0V, TA=25℃下测量得出。
交流(开关)参数:Vcc=5.0V, TA=25℃
符号 | 参数名称 | 从(输入) | 到(输出) | 测试条件 | 参数值 | 单位 | ||
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最小 | 典型 | 最大 | ||||||
fmax | 最大时钟频率 | 时钟 CLK | 30 | 50 | MHz | |||
tPHL | 传输延迟时间 | 清零 CLR | 26 | 35 | ns | |||
tPLH | 传输延迟时间 | 时钟 CLK | CL=45pF | 17 | 25 | ns | ||
tPHL | 传输延迟时间 | RL=667Ω | 22 | 30 | ||||
tPZH | 输出使能时间 | 输出控制 | Q | 15 | 23 | ns | ||
tPZL | 输出使能时间 | M、 N | 18 | 27 | ||||
tPHZ | 输出禁止时间 | 输出控制 | 11 | 20 | ns | |||
tPLZ | 输出禁止时间 | M、 N | CL=5pF RL=667Ω | 11 | 17 |